Architectures Reconfigurables Dynamiquement dédiées aux traitements en temps réel des signaux vidéo
Auteur / Autrice : | Hassane Guermoud |
Direction : | Serge Weber |
Type : | Thèse de doctorat |
Discipline(s) : | Instrumentation et micro-électronique |
Date : | Soutenance en 1997 |
Etablissement(s) : | Nancy 1 |
Partenaire(s) de recherche : | autre partenaire : Université Henri Poincaré Nancy 1. Faculté des sciences et techniques |
Résumé
Depuis quelques années les systèmes de vision à base de circuits reconfigurables FPGA s'imposent comme une solution intermédiaire entre les systèmes à processeurs et les systèmes à circuits dédiés ASIC. La reconfigurabilité des circuits FPGA-SRAM est devenue un atout incontournable pour le développement de plusieurs applications avec le même support matériel. Pour ce travail nous nous sommes plus particulièrement intéressés à la reconfiguration dynamique (RD) de ces circuits. Ce mode de configuration se traduit par un changement rapide de leur structure interne pendant l'exécution des traitements. De nouvelles règles de conception sont alors définies, notamment la décomposition des algorithmes que l'on souhaite implanter sous forme de modules exclusifs au niveau tâche. Ceux-ci possèdent donc la particularité de s'exécuter en cascade indépendamment les uns des autres. Le domaine du traitement d'images bas niveau en temps réel se décompose aisément en un ensemble d'opérateurs chaînés. Cependant, l'utilisation de la RD dans ce domaine, nous impose impérativement le respect du temps réel vidéo et la prise en compte du temps de reconfiguration des circuits FPGA-SRAM. En aucun cas cette dernière contrainte ne doit entraver ou ralentir la vitesse des traitements. De ce fait, nous avons développé deux architectures à reconfiguration dynamique dont les propositions techniques ont été détaillées. Elles sont basées sur la désynchronisation du flot vidéo et du flot de traitement. Par ailleurs nous proposons un critère permettant d'évaluer et de comparer d'une part les deux architectures entre elles et d'autre part l'architecture à RD avec un système classique n'utilisant pas ce mode de reconfiguration. Afin de valider le concept, nous avons choisi un ensemble d'opérateurs de traitements d'images bas niveau en vue de les implanter sur le module à reconfiguration dynamique (MOD_ARD) développé au laboratoire (LIEN).